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- 如何在一周内快速入门UVM验证平台？ - 知乎
一、uvm_验证平台 uvm验证平台由agent、env、base_test、test_top四大组件组成，其中env中又包含了agent、reference model（参考模型）、register model（寄存器模型） 、scoreboard组件，其中agent中又封装了driver、monitor、sequencer组件，另外还有virtual sequence 、virtual sequencer组件（可以封装在base_test下）用来进行对不同
- 一起学习UVM COOKBOOK - 知乎
本文使用 Zhihu On VSCode 创作并发布 将testbench连接到DUT 概述 本节，我们主要讨论将UVM testbench连接到RTL DUT的问题。 UVM testbench对象不能直接连接到DUT信号来驱动或采样。driver和monitor组件对象与DUT之间的连接是通过一个或多个具有静态信号端口的…
- IC设计人员有没有学习UVM的必要？ - 知乎
有必要学习的，uvm也是数字ic验证工程师必须要掌握的内容，uvm是以sv类库为主体的验证平台开发框架，验证工程师可以利用其可重用组件构建具有标准化层次结构和接口的功能验证环境。
- FPGA仿真有必要采用uvm或ovm等高级验证方法吗？ - 知乎
所有的agent都要派生自uvm_agent类，且其本身是一个component，应该使用uvm_component_utils宏来实现factory注册。 is_active是uvm_agent的一个成员变量，其默认值为UVM_ACTIVE,这种模式下用于输入端口，是需要实例化driver和sequencer的，另一种为UVM_PASSIVE模式，用输出端口，不需要
- UVM cookbook整理笔记 - 知乎
一年级芯片验证工程师，UVM cookbook整理
- uvm 使用 factory 需要注意什么？ - 知乎
这里245行通过uvm_factory中的静态函数get()获取了uvm_factory的唯一实例，这就是我们在前面的文章中反复提及的单例模式的使用，例如uvm_root的唯一实例是uvm_top，uvm_factory的唯一实例是factory，这里在uvm源代码中都已经做成了全局变量，如下图所示
- 在vcs下跑UVM验证平台遇到这个问提，该怎么解决？ - 知乎
可以看到uvm_root具备了单例模式的所有因素，所以调用uvm_root在整个UVM环境运行时有且只有一个实例，并且在uvm_root的325行还定义了一个全局可见的uvm_root的实例常量uvm_top，这就是为什么我们可以直接使用uvm_top来调用uvm_root中定义的诸如print_topology()之类的函数的
- UVM 比 VMM 好在哪？ 去哪里找学习的资料？ - 知乎
uvm是推出的验证方法学的新的标准，所以，不用考虑兼容问题，架构会比较清晰。源代码可读性会比较强。 源代码可读性会比较强。 UVM方法学更多的提出了验证平台如何配置，配置类应该怎么规划，如何在系统验证中可重用具体方法和思路。
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